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Encoding:
Internet Message Format  |  1996-08-05  |  1.1 KB
  1. Path: in2p3.fr!usenet
  2. From: Jean Marie Bussat <bussat>
  3. Newsgroups: comp.sys.m68k
  4. Subject: cache controller
  5. Date: 9 Jan 1996 13:14:36 GMT
  6. Organization: Centre de Calcul In2p3
  7. Message-ID: <4ctpns$6i2@ccpnws.in2p3.fr>
  8. NNTP-Posting-Host: lapphp.in2p3.fr
  9. Mime-Version: 1.0
  10. Content-Type: text/plain; charset=us-ascii
  11. Content-Transfer-Encoding: 7bit
  12. X-Mailer: Mozilla 1.1N (X11; I; HP-UX A.09.04 9000/897)
  13. X-URL: news:comp.sys.m68k
  14.  
  15. Hello everybody,
  16.  
  17. I am currently designing a 68020/030 based mother board and I'm wondering if
  18. there is a cache controller in the 680x0 familly (such as the I82385 for the
  19. 386 cpu). I already have a schematic for a cache controller designed whith
  20. standard logic circuits but it don't save space and I want a small (100x160mm
  21. for cpu+cache+fpu+(mmu in case of a 68020)) board.
  22.  
  23. Thanks in advance for any kind of information.
  24.  
  25. Jean-Marie
  26.  
  27. +------------------------------------------------+
  28. | Jean-Marie Bussat - BP110 - Chemin de Bellevue |
  29. | 74941 ANNECY-LE-VIEUX - FRANCE                 |
  30. | Email: bussat@lapp.in2p3.fr    Tel:33 50091747 |
  31. +------------------------------------------------+
  32.  
  33.